Formal Semantics and Proof Techniques for Optimizing VHDL Models

Name: Formal Semantics and Proof Techniques for Optimizing VHDL Models
Brand: Springer-Verlag New York Inc.
SKU: 06796876
Price: 107.29 EUR
Availability: InStock
Author: Kothanda Umamageswaran
ISBN: 9781461373315

Kothanda Umamageswaran

Sheetanshu L. Pandey

Philip A. Wilsey

Sprache

Englisch

Buch Broschur

Libristo-Code: 06796876

Verlag Springer-Verlag New York Inc., November 1998

Written expressly for hardware designers, this book presents a formal model of VHDL clearly specifyi... Vollständige Beschreibung

Libristo-Code: 06796876

263 b

107.29 € inkl. MwSt.

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Written expressly for hardware designers, this book presents a formal model of VHDL clearly specifying both the static and dynamic semantics of VHDL. It provides a mathematical framework for representing VHDL constructs and shows how those constructs can be formally manipulated to reason about VHDL.

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Informationen zum Buch

Vollständiger Name Formal Semantics and Proof Techniques for Optimizing VHDL Models

Autor Kothanda Umamageswaran, Sheetanshu L. Pandey, Philip A. Wilsey

Sprache

Englisch

Einband Buch - Broschur

Datum der Veröffentlichung 1998

Anzahl der Seiten 158

EAN 9781461373315

ISBN 146137331X

Libristo-Code 06796876

Verlag Springer-Verlag New York Inc.

Gewicht 290

Abmessungen 155 x 235 x 11

Kategorie

Technologie, Ingenieurswissenschaft, Landwirtschaft, Industrieprozesse > Elektronik, Nachrichtentechnik > Elektronik > Schaltkreise und Komponenten (Bauteile)

Technologie, Ingenieurswissenschaft, Landwirtschaft, Industrieprozesse > Energietechnik, Elektrotechnik und Energiemaschinenbau > Elektrotechnik

EDV und Informationstechnologie > Grafische und digitale Media-Anwendungen > Computer-Aided Design (CAD)

EDV und Informationstechnologie > Computerprogrammierung und Softwareentwicklung > Programmier- und Skriptsprachen, allgemein

Mathematik und Naturwissenschaften > Mathematik

EDV und Informationstechnologie > Computerhardware

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